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內存可見性
在執(zhí)行變量寫操作后,執(zhí)行l(wèi)ock指令,這個指令將變量實時寫入到主內存而不是處理器的緩存中,然后其他處理器通過緩存一致性協議嗅探到這個變量的變更,將該變量的緩存設置為無效,從而實現內存可見性。
禁止代碼重排序 重排序分類:
編譯器優(yōu)化的重排序。編譯器在不改變單線程程序語義的前提下,可以重新安排語句的執(zhí)行順序。
指令級并行的重排序?,F代處理器采用了指令級并行技術(Instruction-LevelParallelism,ILP)來將多條指令重疊執(zhí)行。如果不存在數據依賴性,處理器可以改變語句對應機器指令的執(zhí)行順序。
內存系統(tǒng)的重排序。由于處理器使用緩存和讀/寫緩沖區(qū),這使得加載和存儲操作看上去可能是在亂序執(zhí)行。
volatile的兩條實現原則
1. Lock前綴指令會引起處理器緩存回寫到內存 2. 一個處理器的緩存回寫到內存會導致其他處理器的緩存無效
寫入變量值不依賴變量的當前值時。因為如果依賴當前值,將是獲取—計算—寫入三步操作,這三步操作不是原子性的,而volatile不保證原子性。
讀寫變量值時沒有加鎖。因為加鎖本身已經保證了內存可見性,這時候不需要把變量聲明為volatile的。
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