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今天就跟大家聊聊有關(guān)在進(jìn)行EMC測試時(shí)有哪些規(guī)范需要注意,可能很多人都不太了解,為了讓大家更加了解,小編給大家總結(jié)了以下內(nèi)容,希望大家根據(jù)這篇文章可以有所收獲。
電磁干擾的三要素是干擾源、干擾傳輸途徑、干擾接收器。EMC就圍繞這些問題進(jìn)行研究。最基本的干擾抑制技術(shù)是屏蔽、濾波、接地。它們主要用來切斷干擾的傳輸途徑。廣義的電磁兼容控制技術(shù)包括抑制干擾源的發(fā)射和提高干擾接收器的敏感度,但已延伸到其他學(xué)科領(lǐng)域。
在印制電路板設(shè)計(jì)階段對電磁兼容考慮將減少電路在樣機(jī)中發(fā)生電磁干擾,問題的種類包括公共阻抗耦合、串?dāng)_、高頻載流導(dǎo)線產(chǎn)生的輻射和通過由互連布線和印制線形成的回路拾取噪聲等,那么在進(jìn)行EMC測試時(shí)具體有哪些規(guī)范需要我們注意?
在高速邏輯電路里,這類問題特別脆弱,原因有很多:
1、電源與地線的阻抗隨頻率增加而增加,公共阻抗耦合的發(fā)生比較頻繁;
2、信號頻率較高,通過寄生電容耦合到步線較有效,串?dāng)_發(fā)生更容易;
3、信號回路尺寸與時(shí)鐘頻率及其諧波的波長相比擬,輻射更加顯著。
4、引起信號線路反射的阻抗不匹配問題。
一、總體概念及考慮
1、五一五規(guī)則,即時(shí)鐘頻率到5MHz或脈沖上升時(shí)間小于5ns,則PCB板須采用多層板。
2、不同電源平面不能重疊。
3、公共阻抗耦合問題。
VN1=I2ZG為電源I2流經(jīng)地平面阻抗ZG而在1號電路感應(yīng)的噪聲電壓。
由于地平面電流可能由多個(gè)源產(chǎn)生,感應(yīng)噪聲可能高過模電的靈敏度或數(shù)電的抗擾度。
解決辦法:
①模擬與數(shù)字電路應(yīng)有各自的回路,最后單點(diǎn)接地;
②電源線與回線越寬越好;
③縮短印制線長度;
④電源分配系統(tǒng)去耦。
4、減小環(huán)路面積及兩環(huán)路的交鏈面積。5、一個(gè)重要思想是:PCB上的EMC主要取決于直流電源線的Z
1、 晶振盡可能靠近處理器
2、 模擬電路與數(shù)字電路占不同的區(qū)域
3、 高頻放在PCB板的邊緣,并逐層排列
4、 用地填充空著的區(qū)域
三、布線
1、電源線與回線盡可能靠近,最好的方法各走一面。
2、為模擬電路提供一條零伏回線,信號線與回程線小與5:1。
3、針對長平行走線的串?dāng)_,增加其間距或在走線之間加一根零伏線。
4、手工時(shí)鐘布線,遠(yuǎn)離I/O電路,可考慮加專用信號回程線。
5、關(guān)鍵線路如復(fù)位線等接近地回線。
6、為使串?dāng)_減至最小,采用雙面#字型布線。
7、高速線避免走直角。
8、強(qiáng)弱信號線分開。
四、屏蔽
1、屏蔽 > 模型:
3、信號電路屏蔽罩的接地。
接地點(diǎn)選在放大器等輸出端的地線上。
4、對電纜屏蔽層,L < 0.15λ時(shí),一般均在輸出端單點(diǎn)接地。L<0.15λ時(shí),則采用多點(diǎn)接地,一般屏蔽層按0.05λ或0.1λ間隔接地?;旌辖拥貢r(shí),一端屏蔽層接地,一端通過電容接地。
5、對于射頻電路接地,要求接地線盡量要短或者根本不用接線而實(shí)現(xiàn)接地。最好的接地線是扁平銅編織帶。當(dāng)?shù)鼐€長度是λ/4波長的奇數(shù)倍時(shí),阻抗會(huì)很高,同時(shí)相當(dāng)λ/4天線,向外輻射干擾信號。
6、單板內(nèi)數(shù)字地、模擬地有多個(gè),只允許提供一個(gè)共地點(diǎn)。
7、接地還包括當(dāng)用導(dǎo)線作電源回線、搭接等內(nèi)容。
六、濾波
1、選擇EMI信號濾波器濾除導(dǎo)線上工作不需要的高頻干擾成份,解決高頻電磁輻射與接收干擾。它要保證良好接地。分線路板安裝濾波器、貫通濾波器、連接器濾波器。從電路形式分,有單電容型、單電感型、L型、π型。π型濾波器通帶到阻帶的過渡性能最好,最能保證工作信號質(zhì)量。 一個(gè)典型信號的頻譜:
Cmin≈△I△t/△Vmax △Vmax一般取2%的干擾電平。
注意減小電容引線電感,提高諧振頻率,高頻應(yīng)用時(shí)甚至可以采取四芯電容。電容的選取是非常講究的問題,也是單板EMC控制的手段。
看完上述內(nèi)容,你們對在進(jìn)行EMC測試時(shí)有哪些規(guī)范需要注意有進(jìn)一步的了解嗎?如果還想了解更多知識或者相關(guān)內(nèi)容,請關(guān)注億速云行業(yè)資訊頻道,感謝大家的支持。
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