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mig讀寫時(shí)序下板實(shí)現(xiàn)是怎么進(jìn)行的,相信很多沒(méi)有經(jīng)驗(yàn)的人對(duì)此束手無(wú)策,為此本文總結(jié)了問(wèn)題出現(xiàn)的原因和解決方法,通過(guò)這篇文章希望你能解決這個(gè)問(wèn)題。
本實(shí)驗(yàn)和工程基于Digilent的Arty Artix-35T FPGA開發(fā)板完成。
軟件使用Vivado 2018.1。
mig讀寫時(shí)序下板實(shí)現(xiàn)
1頂層文件和約束文件
ddr3_test.v
參見參考工程:ddr3_test。
ddr3.xdc
set_property PACKAGE_PIN E3 [get_ports clk]
set_property IOSTANDARD LVCMOS33 [get_ports clk]
set_property PACKAGE_PIN D9 [get_ports reset]
set_property PACKAGE_PIN E1 [get_ports init_calib_complete]
set_property IOSTANDARD LVCMOS33 [get_ports init_calib_complete]
set_property IOSTANDARD LVCMOS33 [get_ports reset]
2 下板實(shí)現(xiàn)讀寫時(shí)序
1>①完成綜合和實(shí)現(xiàn)
2>下載bit文件和debug文件。
3>下載完成,查看波形。
4>將app_wdf_data數(shù)據(jù)格式改為Unsigned Decimal。
5>查看寫時(shí)序。
6>查看讀時(shí)序。
基于xilinx mig ip對(duì)ddr3讀寫驗(yàn)證完成。
看完上述內(nèi)容,你們掌握mig讀寫時(shí)序下板實(shí)現(xiàn)是怎么進(jìn)行的的方法了嗎?如果還想學(xué)到更多技能或想了解更多相關(guān)內(nèi)容,歡迎關(guān)注億速云行業(yè)資訊頻道,感謝各位的閱讀!
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